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  • 匿名
关注:1 2013-05-23 12:21

求翻译:We modify SimpleScalar to model a time-accurate, fivestage, in-order pipeline. Table 2 shows the processor configuration. The pipeline blocks during L1D misses caused by load operations and is lock-free during one outstanding miss caused by a store or a prefetch from the TAB. Table 3 presents the energy for each access t是什么意思?

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We modify SimpleScalar to model a time-accurate, fivestage, in-order pipeline. Table 2 shows the processor configuration. The pipeline blocks during L1D misses caused by load operations and is lock-free during one outstanding miss caused by a store or a prefetch from the TAB. Table 3 presents the energy for each access t
问题补充:

  • 匿名
2013-05-23 12:21:38
我们修改SimpleScalar的一个时间准确,网络vestage ,按顺序管道模型。
  • 匿名
2013-05-23 12:23:18
我们修改simplescalar模拟时间的准确,fivestage、顺序管线。 表2显示了配置的处理器。 管道在L1D的失误加载操作,锁定期间免费小姐一个突出而造成的一个存储或从一个预取”选项卡。 表3显示了能源的每次访问的单位数据存储器。 我们估计能量值的选项卡使用仙人掌,只提供数据阵列高速缓存为8-线高速缓存。
  • 匿名
2013-05-23 12:24:58
我们修改SimpleScalar塑造时间准确,fivestage,在秩序管道。 表2展示处理器精读figuration。 管道块在装载操作造成的L1D错过期间和在商店或先提取造成的一卓著的错过期间是无锁从表格。 表3提出能量为对单位的每通入在数据记忆。 我们通过用仙人掌为8线贮藏所提供仅数据组贮藏所力量估计制表符能量价值。 我们通过审查比率称4词条和2词条价值在16词条和8词条贮藏所之间 (由于缺乏信息为更小的贮藏所大小)。 在L1D错过期间,我们的评估包括能量用法。
  • 匿名
2013-05-23 12:26:38
我们修改体系结构模型的时间准确、 fivestage、 在定单处理管道。表 2 显示处理器 configuration。管道阻塞在完成了 L1D 失误造成加载操作期间并无锁在一个期间优秀小姐一家商店或预回迁选项表 3 从引起给能量为每次访问数据存储器的单位。我们利用仙人掌为 8 线缓存提供只有数据阵列缓存功率估计选项卡的能量值。我们通过研究 16 项和 8 项缓存 (较小的高速缓存大小的信息缺乏) 之间的比例缩放 4 项和 2 项的值。我们评价期间完成了 L1D 错过包括能源的耗用量。
  • 匿名
2013-05-23 12:28:18
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