|
关注:1
2013-05-23 12:21
求翻译:Error (10158): Verilog HDL Module Declaration error at clk_seg.v(1): port "clk" is not declared as port是什么意思?![]() ![]() Error (10158): Verilog HDL Module Declaration error at clk_seg.v(1): port "clk" is not declared as port
问题补充: |
|
2013-05-23 12:21:38
未声明为端口错误(10158):Verilog HDL语言模块(1)clk_seg.v宣言“的错误:端口”CLK“
|
|
2013-05-23 12:23:18
错误(10158__LW_AT__):Verilog HDL模块错误宣言在clk_seg V(1):港口"赤_P角”是不宣布为港口
|
|
2013-05-23 12:24:58
正在翻译,请等待...
![]() |
|
2013-05-23 12:26:38
错误 (10158): 在 clk_seg.v(1) 语言 HDL 模块声明错误: 端口"赤"不被声明为端口
|
|
2013-05-23 12:28:18
正在翻译,请等待...
![]() |
湖北省互联网违法和不良信息举报平台 | 网上有害信息举报专区 | 电信诈骗举报专区 | 涉历史虚无主义有害信息举报专区 | 涉企侵权举报专区