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  • 匿名
关注:1 2013-05-23 12:21

求翻译:  CPLD内连率高,不需要人工布局布线来优化速度和面积,较FPGA更适合于EDA芯片设计的可编程验证;是什么意思?

待解决 悬赏分:1 - 离问题结束还有
  CPLD内连率高,不需要人工布局布线来优化速度和面积,较FPGA更适合于EDA芯片设计的可编程验证;
问题补充:

  • 匿名
2013-05-23 12:21:38
cpld even rate, does not require manual layout to optimize speed and area than the fpga is more suitable for design eda chip, programmable verification;
  • 匿名
2013-05-23 12:23:18
  • 匿名
2013-05-23 12:24:58
  • 匿名
2013-05-23 12:26:38
  • 匿名
2013-05-23 12:28:18
 
 
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